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5
LTC1448
W
I
DAGRA
BLOCK
24-BIT
SHIFT
REGISTER
POWER-ON
RESET
LD
DAC B
REGISTER
LD
DAC A
REGISTER
12-BIT
DAC A
–
+
–
+
8
VOUT B
7
VCC
6
GND
5
VOUT A
12-BIT
DAC B
1
2
3
4
CLK
DIN
CS/LD
REF
1448 BD
TI I G DIAGRA S
U
W
CLK
DIN
CS/LD
t8
t4
t3
t5
B11-A
MSB
B0-A
LSB
B11-B
MSB
B0-B
LSB
t2
t1
t6
t7
B0-B
PREVIOUS WORD
1448 TD02
DIN
CLK
CS/LD
1
2
3
4
56789
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
DAC B INPUT
DAC A INPUT
1448 TD01
D11
D9
D8
D7
D6
D5
D4
D3
D2
D1
D0
D10
D11
D9
D8
D7
D6
D5
D4
D3
D2
D1
D0
D10
(UPDATE DAC OUTPUT)
(ENABLE CLOCK)
OPERATING SEQUENCE
MSB
LSB
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